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典型PC機--馮諾依曼架構(gòu)

馮·諾依曼體系的特點

1）數(shù)據(jù)與指令都存儲在存儲器中

2）被大多數(shù)計算機所采用

3）ARM7——馮諾依曼體系

哈佛體系架構(gòu)

哈佛體系結(jié)構(gòu)的特點

1）程序存儲器與數(shù)據(jù)存儲器分開

2）提供了較大的數(shù)存儲器帶寬

3）適合于數(shù)字信號處理

4）大多數(shù)DSP都是哈佛結(jié)構(gòu)

5）ARM9是哈佛結(jié)構(gòu)

CISC：復(fù)雜指令集（Complex Instruction Set Computer）

具有大量的指令和尋址方式

8/2原則：80%的程序只使用20%的指令

大多數(shù)程序只使用少量的指令就能夠運行

RISC：精簡指令集（Reduced Instruction Set Computer)

在通道中只包含最有用的指令

確保數(shù)據(jù)通道快速執(zhí)行每一條指令

使CPU硬件結(jié)構(gòu)設(shè)計變得更為簡單

流水線技術(shù)：

幾個指令可以并行執(zhí)行

提高了CPU的運行效率

內(nèi)部信息流要求通暢流動

為增加處理器指令流的速度，ARM7 系列使用3級流水線.允許多個操作同時處理，而非順序執(zhí)行。

注，PC指向正被取指的指令，而非正在執(zhí)行的指令

ARM處理器內(nèi)核流水線

超標量執(zhí)行

超標量CPU采用多條流水線結(jié)構(gòu)。

超標量體系結(jié)構(gòu)描述一種微處理器設(shè)計，它能夠在一個時鐘周期執(zhí)行多個指令。在超標量體系結(jié)構(gòu)設(shè)計中，處理器或指令編譯器能夠判斷指令能獨立于其它順序指令而執(zhí)行，還是依賴于另一指令，必須跟其按順序執(zhí)行。處理器然后使用多個執(zhí)行單元同時執(zhí)行兩個或更多獨立指令。超標量體系結(jié)構(gòu)設(shè)計有時稱“第二代RISC”。

高速緩存（CACHE）

1、為什么采用高速緩存
       微處理器的時鐘頻率比內(nèi)存速度提高快得多，高速緩存可以提高內(nèi)存的平均性能。

2、高速緩存的工作原理
        高速緩存是一種小型、快速的存儲器，它保存部分主存內(nèi)容的拷貝。  

總線和總線橋

存儲器系統(tǒng)

RAM：隨機存取存儲器
SRAM：靜態(tài)隨機存儲器
DRAM：動態(tài)隨機存儲器  
1）SRAM比DRAM快
2）SRAM比DRAM耗電多
3）DRAM存儲密度比SRAM高得多
4）DRAM需要周期性刷新
ROM：只讀存儲器
FLASH：閃存